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组合逻辑电路的输出状态仅决定于

发布时间:2019-07-04 03:08 来源:未知 编辑:admin

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  展开全部组合逻辑电路是指在任何时刻,输出状态只决定于同一时刻各输入状态的组合,而与电路以前状态无关,而与其他时间的状态无关。

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