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关于verilog里的 组合逻辑和时序逻辑 要用阻塞赋值和非阻塞赋值

发布时间:2019-07-31 10:30 来源:未知 编辑:admin

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  展开全部在串行语句块中,阻塞型赋值语句按照它们在块中的排列顺序依次执行,即前一条语句没有完成赋值之前,后面的语句都不能被执行

  首先执行第一条语句,将A赋给B,接着执行第二条,讲B(A+1)的值赋给C,即C=A+1。

  首先计算机所有表达式右边的值并分别存储在暂存器中,在begin和end之间所有非阻塞型赋值语句的右边表达式都被同时计算并存储后,对左边寄存器变量的赋值操作才会进行。

  别混用,这是要求,其实如果你不考试的话,知道这些就够了,没必要非知道为什么,呵呵

  到工作中你就知道了,学的那些verilog语法好多都不让用的,能用的就那么一些。

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